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Une analyse mathématique est faite pour tenir compte d'une variété de questions de conception telles que la topologie, la bibliothèque de tampons et le changement de phase en présence d'inverseur. En combinant la programmation dynamique et les techniques branch-and-bound, une méthode hybride est présentée qui améliore le temps d'exécution tout en conservant une utilisation de mémoire raisonnable. Les concepts mathématiques et algorithmiques fondamentaux utilisés dans ce mémoire peuvent être employés pour généraliser la méthode proposée pour un ensemble de charges avec des capacités et des temps requis différents.","abstract_html":"Avec la miniaturisation actuelle, les circuits démontrent de plus en plus l&#x27;importance des délais d&#x27;interconnexion. Afin de réduire ce délai, l&#x27;insertion de tampons doit être effectuée durant la synthèse logique et la synthèse physique. Cette activité d&#x27;optimisation est souvent basée sur la programmation dynamique. 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